[情報] PCIE-6.0 全球首發完整方案：用上5nm工藝
PCIe 4.0還在普及階段，PCIe 5.0尚未到來，PCIe 6.0標準規範還沒完成
廠商們就已經迫不及待出方案了。
Synopsys(新思科技)宣佈，推出全球首個完整的PCIe 6.0 IP方案
包括控制器、PHY實體層、驗證IP，可供PCIe 6.0 SoC設計早期開發之用。
https://i.imgur.com/HLcTVlW.png
包括64GT/s PAM-4信號調製、FLIT模式、L0p低功耗模式等等
可滿足HPC高性能計算、AI、存儲SoC等應用領域對於延遲、頻寬、能效的各種需求。
為了實現輸送量的最大化、延遲的最小化，Synopsys PCIe 6.0控制器採用了
“MultiStream”(多流)架構，性能可達單流架構的最高2倍，並且還有1024-bit寬度架構
可以在關閉1GHz時序的同時，達到64GT/s x16的高頻寬，還優化了多資料來源、多虛擬通道環境。
此外，新方案使用了獨特的自我調整DSP演算法，支援早期SoC開發，優化類比和數位均衡無論何種通道下都能獲得最佳能效，並且基於專利診斷功能，可確保幾乎零宕機時間。
值得一提的是，PHY實體層還使用了先進的5nm工藝，搭配獨特的模擬和DSP技術，可將功耗降低20％。
Synopsys PCIe 6.0 IP方案中的驗證IP現已可用，控制器、PHY實體層計畫在今年第三季度提供早期試用。
PCIe 6.0標準規範目前還在制定中，計畫在今年正式發佈，按照傳統繼續讓I/O頻寬翻番達到64GT/s
應用到實際中，PCIe 6.0 x1單向實際頻寬8GB/s，PCIe 6.0 x16單向頻寬128GB/s、雙向頻寬256GB/s。
PCIe 6.0將延續PCIe 3.0時代引入的128b/130b編碼方式，但加入全新的脈衝幅度調製
PAM4
取代PCIe 5.0 NRZ，可以在單個通道、同樣時間內封包更多資料
以及低延遲前向糾錯(FEC)和相關機制，以改進頻寬效率。
https://news.mydrivers.com/1/746/746466.htm
4.0 都還沒熱 6.0 在路上
4.0顯示卡買不到
SSD GEN4 買不下手 真矛盾
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INTEL：我還沒上車阿
S社真的很兇..
PCIE 6.0 is worthless
ssd真的是本世紀最偉大的發明 榨乾sata頻寬之後還
要榨乾pcie的頻寬
SSD GEN5 都要比RAM快了吧CPU會不會成為最慢的東西?
GPU都要直通SSD了
蘇媽買IP了沒？
Flash-based SSD 再怎麼提升界面也只是頻寬變大；
Latency 跟 DRAM 比仍不在同個級數，
且連續寫入超過 SLC cache 速度會降很多。
這算是先造好機場，再等飛機造出來嗎 XD
Intel PCIe5就買SNPS的IP 蘇媽別再死抱A了阿
先用在HPC上
CPU都嫌ram慢了 SSD? 想太多
頻寬高但是延遲壓不下來對CPU不好用
除非原本手上就有x99 不然去哪生一堆停產好幾年的板
子
靠北推錯篇
沒卡可用 搞笑
感覺有點2000年末日之前，各種幻想各種夢都在畫，嘻
話說蘇媽5900x是要出貨沒
洗廢文矛盾個屁
自己刻臭了嗎？
隨便你就繼續更新 反正算力不會提升
5.0年底就跟著I皇12代上了
4.0南橋都要用風扇壓了 6.0是要用水冷嗎？
會不會 跳過5.0直上6
ssd搾乾的還有你的錢包
我都還在 3....XD
算力多少？
一般消費者用不到，成本太高，普及還早，連4.0都還
沒普及，這目前只有開發IC用吧
能挖礦嗎
一般消費級的體驗瓶頸也不是卡在Disk IO 吞吐
10GbE連PCIe 3.0 SSD都不夠吃
以飛機比喻的話 是賣你駕駛艙模擬器+風洞+沒飛起來
過的設計圖...等你造飛機
4.0都買不起了QQ
沒辦法，製程卡在7nm太久，還是要拿出一些嚇人的東
西發表
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