Re: [閒聊] 數位ICS下過晶片對於未來有加分嗎?
※ 引述《MAILUNSI (源Z武士)》之銘言:
: 嗨 大家好
: 本肥不才無緣四大,只上了中字輩 ICS
: 跑遍了實驗室才知道大部分兩年畢業的學長們
: 都是FPGA跑完就畢業
: 目前有兩間實驗室在考慮(都是做數位的)
: 碩一下都會報名ics競賽
: 實驗室A- 不用租屋、不可能下晶片、兩年畢
: 實驗室B- 要租屋、會下晶片、平均2.5畢
: 不知道碩班有下晶片與沒下晶片在找工作時的難度會不會差很多?
個人經驗
有下晶片或許有加分
但就算有, 加分也有限
維持好的成績可能還重要點
學校下晶片走得flow跟實際業界還是有些差別
尤其大公司分工比較細
一個部門可能就負責整個design flow中的一部分
很多東西都是進去再學
早點畢業早點進去公司
學校做得東西有些真的沒想像中重要
當然教授可能會把它講得很重要XD
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推
這篇正解
→
其實流程差不多 只是在前期就要考慮佈局跟CTS 這樣繞線時
→
timing才容易收斂 學校不太管sdc要怎下的
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[請益] 碩班有下過晶片會差很多嗎各位晚上好, 小弟目前大三, 也差不多要決定未來研究所的實驗室了, 因為不太了解業界的情況所以想來問問, 在研究所真的有下過一顆晶片的話,23
Re: [請益] 考慮回台工作前mtker + Bruins 覺得應該有點資格回應你 如果是想走ic design的數位設計,回台灣可能要先唸碩士,原因是mtk不訓練新人,多半主管希望你兩個月內可以開始做事,半年內開始上手改module,其他公司我不知道 另外一個原因是ucla ee大學部在數位電路上的課太少深度可能也不夠,而NTUEE有cic資源,課程設計例如DSD等也好很多。剛到UCLA發現一堆eda tool都不能用讓我非常驚訝,如果你沒有使用tool的經驗,就算找到工作也會比其他台灣同學還要依賴mentor手把手帶你用 verdi, lec, ic compiler etc.,然後沒花個半年應該無法熟悉design flow,而且這還是主管願意花人力帶你的情況 如果你gpa正常3.7以上,應該蠻有機會能推甄進NTU GIEE ICS組,你可以去找某位Dejan Markovic的學生,名字我忘了但也是前Bruins,同時他也做數位電路,題目應該是ML加速相關,如果兩年畢業有下線產出publication 會比在UCLA EE MS還要好。畢竟在UCLA的MS除非你簽博,不然幾乎沒有數位下線機會,而且畢業去Q/B/nV等公司也得從DV開始,沒稱個兩三年應該沒機會做架構設計 另外一個選擇是找NTU GIEE的RA職位,但這很靠關係跟運氣,建議直接找教授聊聊22
[請益] offer 請益 數位IC各位年薪300+的前輩好 小弟114 ICS碩畢 近期拿到下列offer 1.SMI SSD digital IC designer Package : N*14+兩次分紅+RSU17
Re: [請益] 代po 台大電子 vs清大電機 類比ICS推文有夠兇 到業界人士比較多的地方問業界生態很好啊 可以直接通靈 為什麼要跟一群活人擠在一起 討論死後究竟是天堂地獄還是西方極樂陰曹地府? 現在履歷看到台大和清大我是沒什麼差了啦17
[請益] Offer 立積/瑞昱各位年薪300萬大大好 小弟我最近一直在猶豫轉職工作該怎麼選擇 想聽聽看各位前輩們的一些經驗與建議 本身四中碩畢做晶片設計 有三年半系統廠RD經驗 公司 立積 瑞昱16
Re: [請益] 碩班校名 or 領域先回答第一個問題 台大電機丙和清大資工碩士在業界沒啥差 台清交基本上算同個等級 然後公司主管其實也搞不太清楚每個學校每個所的分組實際上差在哪啦 看起來你對清大的這間實驗室十分有興趣9
[討論] 文組讀碩士有用嗎嗨嗨 本肥肥有些朋友 文組畢業然後去讀研究所 讀了好幾年都還沒畢業 本肥就在想9
[請益] 智原_職缺請益各位年薪百萬的大大好,小弟最近面試智原_晶片電源完整性驗證(PI)此職缺。 主管說算是APR後段對整個ic做電源驗證的部門,工作內容為大概為: 1. IR Drop分析,確保每顆cell都能保持正常工作。 2. Chip power estimation與flow的建構 3. 會使用tcl做事,所以不能怕打程式5
[請益] P面試職位請益朋友面試 幫忙代po文 小弟四中碩,最近收到P的兩個面試邀請 都是數位IC的職缺,HR也回覆兩者是相同部門(晶片三部) 想在面試前稍微了解一下兩個職缺的工作內容及屬於哪條產品線 [1]數位IC設計工程師0300