Re: [討論] driver ic 有非同步設計嗎？
※ 引述《qhir (普通人的老婆)》之銘言：
: 最近面試幾家小driver ic 豬屎屋，
: 感覺面試的數位主管都對非同步設計不熟，
: 不是不知道async. FIFO 不會overflow / underflow,
: 就是不知道同步時即使data是穩定的，
: 但control signal 仍然要處理，
: 而且不能一次2-bit或2-bit以上…..
: 如果driver ic內部需要處理非同步，
: 真替那兩家公司的未來感到擔憂……
: 是那些公司主管的問題？
: 還是driver ic真的不需要處理非同步也能賺錢？
數位ic幾乎沒有非同步設計
除非妳很懶 低速邏輯用wire一直連
不過看起來你是指傳輸端
不過也很好解 因為都有crc機制
不管傳錯還是你取錯 reset完就叫對方重傳就好^^
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※ PTT 留言評論
※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 101.136.187.167 (臺灣)
※ PTT 網址
※ 編輯: dakkk (101.136.187.167 臺灣), 04/20/2023 15:20:37
→
我知道，這是反串
推
大哥我不是做drive人ic出身的，但你也別把 driver i
→
c說得這麼…….，我知道有的有CDR，所以我猜是面試
→
官個人問題吧？！
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[閒聊] 同步召喚算成功的設計嗎如題 同步召喚 協調+非協調把星星加起來召喚大怪 有些初代粉會覺得這是殺小 環境大加速元兇40
Re: [閒聊] 去年對岸的"八萬懸賞電源線盲測挑戰"我認為在DAC以前的硬體設備沒有太大影響 主要是DAC端才是解碼 在這之前就是0101 0101最怕就是出錯 特別是到DAC的這段 你根本不知道問題會出在哪 到底是做封包就做錯了![Re: [閒聊] 去年對岸的"八萬懸賞電源線盲測挑戰"](https://i.imgur.com/dcacLsyb.jpg "Re: [閒聊] 去年對岸的\"八萬懸賞電源線盲測挑戰\"")
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[心得] 數位ic面試心得最近大徵才, 阿肥我也趁著這次機會面了許多家公司 平常受惠於 PTT & dcard, 因此就來 PO 個面試心得文 以下都是一線IC廠有問到我的問題 就不區分公司了 背景: 混血四大電資碩30
Re: [討論] USB線跟電源線對聲音的影響程度難得討論這麼熱烈浮出來跟風回文請教一下XD 話先說前頭以下僅以我多年前的課本知識&一些工作有overlap部分 自行理解，有錯的麻煩糾正我~~~ /--------/ /---------/ / HOST /---------------/ DEVICE /![Re: [討論] USB線跟電源線對聲音的影響程度](https://i.imgur.com/NyubZeKb.jpg "Re: [討論] USB線跟電源線對聲音的影響程度")
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Re: [新聞] 台61區間測速出包公總認了，問題出在這如果新聞的描述是真的，那我真的覺得這個系統設計的很腦殘..... 一般來說要使用這種區段測速的方式，就是比對兩張照片的時間， 也就是影像檔裡要包含時間的標籤。 依照新聞的描述，當網路延遲時，時間標籤就會錯亂， 代表照片的時間標籤是在主機端而不是在相機端打的。21
[閒聊] USB線材是否會影響『非同步USB DAC』聲音(1) 結論：不會 ！！！ 別再爭了，至少到2021/11/30為止的網路上所有資料，都告訴你不會。 (2) 同步USB DAC (Synchronous USB DAC) 資料參考： 簡單來說，在同步模式下，USB DAC的clock是根據USB訊號(封包)的傳輸![[閒聊] USB線材是否會影響『非同步USB DAC』聲音](https://img.youtube.com/vi/y5Wc-jqPWUY/mqdefault.jpg "[閒聊] USB線材是否會影響『非同步USB DAC』聲音")
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[請益] Synology Driver Client的同步問題請教一下各位，我有買台DS218+，單純只是想把電腦裡面的照片備份到NAS 但是Synology Driver Client同步規則的選項我一直搞不懂"雙向同步"跟"單向上傳" 的差異 我最主要是想把電腦的"照片區"備份到NAS， 然後當我在電腦執行刪除不要的照片時，NAS也跟著刪除3
Re: [討論] PHY design 請教PCS，PMA和PMD 看起來應該是802.3 base-tx 最近剛好在整理相關資料，有錯的話請指教 PHY 主要會有三大塊 DSP(演算法)、數位(控制PMA、PMD、PCS)、類比(PMA和PMD) 一般來說職缺也就是演算法、數位ic設計、類比ic設計 會談到PCS通常是數位的部份
[討論] 請問driver ic內部需要做非同步處理嗎？最近面試了兩家小家的driver ic design house， 感覺面試的數位主管對非同步處理都不太熟， 例如不知道非同步FIFO 不會over flow/under flow, 非同步處理時control signal不能2-bit或2-bit以上， 否則一樣會遇到cdc問題….